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Digital est un simulateur de circuits logiques numériques et un outil de vérification de conception matérielle. Il fournit un environnement visuel pour concevoir, tester et vérifier des circuits électroniques en utilisant la simulation basée sur les événements et la synthèse logique automatisée. La plateforme fonctionne comme un outil de synthèse logique qui applique l'algèbre booléenne pour minimiser les configurations de portes et convertir les tables de vérité en matériel efficace. Elle sert également d'outil d'exportation HDL, traduisant des graphes de circuits visuels en code VHDL ou Verilog, et d'outil de déploiement CPLD qui génère des fichiers JEDEC pour flasher des puces logiques programmables. Le logiciel couvre un large éventail de fonctionnalités, notamment la conception de machines à états finis, l'organisation hiérarchique et paramétrée des circuits, et la visualisation de l'état des signaux. Il inclut des utilitaires pour la vérification logique automatisée, le suivi de la propagation des signaux et une interface distante basée sur TCP pour la gestion du simulateur et le débogage de systèmes embarqués.